Cadence AI 荣膺 L5 级认证，全球首款全自主虚拟芯片工程师问世
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作者：晨晞
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这并非实验室的演示 Demo，而是已深度集成全球顶级 EDA 工具链的商业化产品。该 AI 超级智能体适配芯片全流程设计验证工作，可配合 Cadence Xcelium 逻辑仿真、Jasper 形式验证工具开展动态仿真测试。
目前英伟达工程师已大规模部署该方案，将原本五周的芯片 RTL 验证周期压缩至一天以内，效率提升超 40 倍，极大优化了复杂半导体研发流程。AI 能够自主执行仿真、形式化验证、缺陷定位及 Bug 修复，全流程自驱动运行，工程师仅需在关键节点进行审核确认。
一
ChipStack AI 的演进历程
ChipStack 并非 Cadence 独立孵化。2023 年，Kartik Hegde 离开 AI2 孵化器，在西雅图创立 ChipStack，专注 AI Agent 芯片验证。团队仅 20 人，获得 AI2 和 Khosla Ventures 等机构 700 万美元融资。
2025 年 11 月，Cadence 完成收购，Hegde 带领团队入驻加州总部。四个月后，ChipStack AI Super Agent 在 CadenceLIVE 2026 首发。再过两个月即宣布达成 L5 级，从被收购到获 L5 认证不足 7 个月。
速度背后是 Cadence 对“Agent 化”路线的坚定投入。同期发布的 ViraStack（仿真）与 InnoStack（数字实现/签核），构建了覆盖验证、仿真、实现的完整 AI Agent 产品矩阵。
二
L1-L5 代表什么？
EDA 行业将 AI 定义为五个自治等级，类似于自动驾驶系统：
L5 的核心区别在于：不是“AI 提供建议由人执行”，而是“AI 独立完成，仅由人审核”。
具体到 ChipStack，其 L5 工作流如下：
1. Codex（总指挥）接收设计需求
2. ChipStack 启动 RTL 验证循环
3. Nemotron 大模型作为推理引擎驱动决策
4. OpenShell 沙箱提供安全隔离的执行环境
5. 调度多个专家子 Agent：RTL 生成、测试平台创建、回归测试、调试
6. 用 Cadence Xcelium 跑数百次仿真、Jasper 做形式化验证
7. 发现 bug → 自动定位 → 自动修复 → 重新验证
全流程自驱动，人类可随时介入但非必须。验证环节天然适合多 Agent 协作，而 RTL 生成仅需单 Agent，ChipStack 选择验证作为切入点并非偶然。
相比传统 AI 辅助工具，L5 级 ChipStack AI Super Agent 无需分步指令，能自主评估结果、迭代决策，独立完成规格解读、RTL 生成、验证规划、仿真调试及设计收敛等全链条任务。
工程师角色从繁琐执行转向进度监督与目标引导，工具兼容 Codex、Claude Code 等平台，确保全程透明、可协作、可核查。
在工程精度与安全方面，该智能体深度绑定 Cadence 物理级高精度验证引擎，所有 AI 操作基于成熟可信模型，保障量产级设计精度。
同时依托 NVIDIA OpenShell 沙箱环境，通过权限隔离、策略管控、数据分级访问等机制，严格保护核心 IP，实现 AI 自主工作流的合规安全落地。
NVIDIA 表示，此次合作将可控自主能力引入研发流程，兼顾速度与安全，为高端半导体设计验证提供新路径。Cadence 也在持续迭代 AI 代理矩阵，布局多场景 AI 超级智能体及 AgentStack 编排框架，推动全流程智能化。
据悉，ChipStack AI Super Agent 与 AgentStack 编排框架的 L5 自主能力将于 2026 年下半年面向早期客户开放。
ChipStack 达成 L5，不仅是产品里程碑，更是信号：EDA 正从“软件工具”向“AI 操作系统”转型。
正如智能手机时代用户只关注 App 体验而非底层芯片品牌。未来芯片设计工程师关注的可能不再是 Cadence 或 Synopsys，而是哪个 AI Agent 更聪明、更可靠。
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